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201780053287.6-存储器中的差错校验和纠正码的扩展应用
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申请人: 英特尔公司 申请日: 2017-08-30 主分类号: G06F11/10 公开号: 109661654A 公开日: 2019-04-19
摘要: ECC（差错校验和纠正）能够扩展到允许ECC码纠正存储器子阵列差错。存储器装置包括与诸如控制器之类的外部装置接口连接的多个输入/输出（I/O）连接器。存储器装置包括特定地映射到I/O连接器而不是任意地路由的多个阵列或子阵列。照此，存储器子阵列的数据通路能够排他性地路由到特定I/O连接器。I/O连接器能够与单个存储器子阵列唯一地相关联，或多个存储器子阵列能够映射到特定I/O连接器。映射根据码矩阵，其中，ECC码矩阵的与特定I/O连接器相对应的码要用来校验且纠正相关联的一个或多个存储器子阵列的数据损坏差错和I/O差错。
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200680037413.0-用于在通信系统中进行位置管理及寻呼的技术
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申请人: 英特尔公司 申请日: 2006-11-08 主分类号: H04L12/28 公开号: 101283545A 公开日: 2008-10-08
摘要: 描述了用于对空闲模式移动台进行位置管理及寻呼操作的系统和技术。一种装置可包括第一外地代理，其具有外地代理空闲模式管理器，用于存储无线网络的第一寻呼区域中空闲移动台的空闲模式信息。描述并要求保护了其它实施例。
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200880112595.2-用于多频带应用的使用低损耗衬底层叠的多层小型的嵌入式天线
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申请人: 英特尔公司 申请日: 2008-10-10 主分类号: H01P1/24 公开号: 101828301A 公开日: 2010-09-08
摘要: 多频带前端模块(FEM)结合多层塑料衬底层叠，其中，金属层在层叠中的衬底层上图案化以提供小型的单极型天线。
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201780038679.5-支持用于一组公共互连连接器的多种互连协议的技术
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申请人: 英特尔公司 申请日: 2017-06-14 主分类号: G06F13/42 公开号: 109416677A 公开日: 2019-03-01
摘要: 实施例通常可以直接涉及用于确定多个连接器的配置的装置、系统、方法和技术，配置用于将第一互连协议与多个连接器的第一子集进行关联，并且将第二互连协议与多个连接器的第二子集进行关联，第一互连协议和第二互连协议是不同的互连协议，并且各自包括串行链路协议、相干链路协议和加速器链路协议中的一个，使得根据第一互连协议来处理数据以用于经由多个连接器的第一子集的通信，并且使得根据第二互连协议来处理数据以用于经由多个连接器的第二子集的通信。
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201780049772.6-镍-锡微凸块结构及其制造方法
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申请人: 英特尔公司 申请日: 2017-08-14 主分类号: H01L23/00 公开号: 109564897A 公开日: 2019-04-02
摘要: 用于在集成电路封装衬底上提供与表面水平微凸块的有效连接的技术和机制。在实施例中，以各种方式对不同的金属进行电镀以形成微凸块，所述微凸块穿过衬底的表面水平电介质延伸到包括铜的种子层。微凸块包括镍和锡，其中镍有助于减轻种子层铜的吸收。在另一个实施例中，微凸块具有锡的质量分数或镍的质量分数，其在沿着微凸块的高度的各个区域中是不同的。
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201810979580.1-用于多相机压缩的编码解码器
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申请人: 英特尔公司 申请日: 2018-08-27 主分类号: H04N21/218 公开号: 109561317A 公开日: 2019-04-02
摘要: 一种半导体封装装置的实施例可以包括如下技术，该技术用于处理包括来自两个或更多个视频源的帧信息的单个视频帧流，并且基于来自单个视频帧流中的先前帧的信息来处理当前帧，该先前帧比当前帧领先基于单个视频帧流中表示的视频源的数量的帧数。公开并要求保护其他实施例。
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201810973600.4-用于流控制分组处理的技术
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申请人: 英特尔公司 申请日: 2018-08-24 主分类号: H04L29/06 公开号: 109561064A 公开日: 2019-04-02
摘要: 描述了用于处理数据单元的技术和装置。在一个实施例中，例如，用于联网的装置可以包括至少一个存储器，逻辑，逻辑的至少一部分包括在耦合到至少一个存储器的硬件中，所述逻辑用于访问具有加密的部分的加密的分组，确定加密的部分的至少一个流控制段，对至少一个流控制段进行解密以生成部分解密的分组，该部分解密的分组包括解密的至少一个流控制段和加密的其余部分，其余部分包括加密的分组的不包括解密的至少一个流控制段的部分，访问解密的至少一个流控制段中的处理信息，并根据处理信息来处理部分解密的分组。描述并要求保护其他实施例。
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201810973067.1-低等待时间加速器
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申请人: 英特尔公司 申请日: 2018-08-24 主分类号: G06F9/30 公开号: 109558168A 公开日: 2019-04-02
摘要: 本申请公开了低等待时间加速器。用于减少加速器中的等待时间的方法、装置和相关技术以及机制。该技术和机制在支持共享虚拟存储器(SVM)并且包括支持SVM的加速器以及转换后备缓冲器(TLB)的使用的平台架构中实现。定义要由加速器执行的作业并引用一个或多个缓冲器的虚拟地址(VA)和大小的请求描述符通过在处理器核上执行线程而入队。在一种方法下，描述符包括提示，该提示包括物理地址或虚拟地址到物理地址(VA‑PA)转换，其使用缓冲器VA从与核相关联的一个或多个TLB获得。在采用TLB监听的另一种方法下，缓冲器VA被用作查找，并且匹配的TLB条目((VA‑PA)转换)被用作提示。该提示用于推测性地预取缓冲器数据，并推测性地开始处理加速器上的预取到的缓冲器数据。
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201780053809.2-具有非功能性柱体的垂直存储器装置
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申请人: 英特尔公司 申请日: 2017-09-04 主分类号: H01L27/11582 公开号: 109643719A 公开日: 2019-04-16
摘要: 公开了固态存储器技术。在一个示例中，固态存储器部件可包括多条位线、源极线以及多个功能性(510)和非功能性(510')存储器柱体。每个非功能性存储器柱体(510')与多条位线和源极线之一或两者电隔离。在另一个示例中，固态存储器部件可包括位于固态存储器部件的外围部分(553)的多个柱体，以及毗邻每个柱体的存储器单元。还公开了关联的系统和方法。
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201780053343.6-可扩展的随机逐次逼近寄存器模数转换器
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申请人: 英特尔公司 申请日: 2017-08-30 主分类号: H03M1/40 公开号: 109644002A 公开日: 2019-04-16
摘要: 一些实施例包括设备和方法，其使用电容器电路对输入信号的值进行采样；使用比较器将输入信号的值与一系列电压值进行比较，并提供比较结果；使用逐次逼近寄存器(SAR)逻辑电路基于比较结果生成第一位和第二位；以及使用电路计算第二位的值与第一位的一部分位的值的平均值，并且生成表示输入信号的值的输出位，该输出位包括基于平均值生成的位。
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